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內容簡介ＰＬＬ（Ｐｈａｓｅ Ｌｏｃｋｅｄ Ｌｏｏｐ：位相同期回路）技術は、周波数安定度の高い信号を生成するための回路技術として広く普及している。そのほかにも、ディジタル・データからのクロック信号の再生、ＦＭ信号の復調、モータの回転速度制御などにも応用できる汎用性の高い回路技術である。 本書では、ＰＬＬ回路におけるループ・フィルタ定数の算出を主題として、具体的な設計事例をできるだけ多く示しながら、回路シミュレーションと実測によりその特性を検証している。 『作者介紹』 遠坂 俊昭 (エンザカ トシアキ) １９４９年群馬県新田郡薮塚本町に生まれる。 １９６６年アマチュア無線局ＪＡ１ＷＶＦを前橋にて開局。１９７３年（株）三工社に入社。１９７７年（株）エヌエフ回路設計ブロックに入社。アイソレーション・アンプ、ロックイン・アンプ、ＦＲＡ、保護リレー試験器などの開発に従事、現在に至る。２００１年文部科学大臣賞受賞（本データはこの書籍が刊行された当時に掲載されていたものです） 目錄第１章 ＰＬＬの動作と回路構成―ＰＬＬとシンセサイザ技術のあらまし Ａｐｐｅｎｄｉｘ Ａ ＰＬＬ回路はＯＰアンプと同じ負帰還の応用 第２章 ＰＬＬ回路の伝達特性―ＰＬＬ回路の特性はループ・フィルタで決まる 第３章 ＰＬＬ回路のループ・フィルタ設計法―パッシブ／アクティブ・ループ・フィルタの設計事例と検証 第４章 ４０４６と位相比較器のいろいろ―ＰＬＬ回路に使用する定番デバイスの基礎知識 第５章 電圧制御発振器ＶＣＯの回路技術―ＶＣＯに求められる特性とさまざまな発振回路の方式 第６章 プログラマブル分周器の種類と動作―ＰＬＬシンセサイザを構成するためのディジタル回路 第７章 ＰＬＬ回路の計測と評価法―パッシブ／アクティブ・ループ・フィルタのループ利得 第８章 ＰＬＬの特性改善ノウハウ―信号純度やロック・スピードを向上させるテクニック 第９章 実用ＰＬＬシンセサイザの設計／製作―ループ・フィルタの詳細設計と実測特性で示す Ａｐｐｅｎｄｉｘ Ｂ ループ・フィルタ設計のための正規化グラフ |
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資料來源：樂天市場購物網
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